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搜索资源 - Verilog Source code
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FPGA的串口+计数器+DPS+数模转换的VERILOG源代码。-The VERILOG source of digital-to-analog conversion of the FPGA serial the+ counter+DPS+ code.
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用VERILOG编写的FPGA控制vga显示的源码-FPGA control the vga display the source code written in VERILOG
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这篇文档主要是描述了fifo的作用，里面有用verilog写的源码，及其综合后的结果-This document mainly describes the role of the FIFO inside useful verilog to write source code, and its consolidated results
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EDA设计源代码，verilog计算器设计-EDA design source code, verilog calculator design
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verilog语言编写的交通灯程序源代码-the Verilog language of traffic lights program source code
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利用VERILOG语言编写的利用查找表进行16QAM调制源代码-Using a Lookup Table the 16QAM modulation source code using Verilog language
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16bit adder的verilog源代码和4bit的计数器源代码-source code for 16bit adder and 4bit counter
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完成通信系统中数据交织器的设计的设计，要求用Verilog HDL编程，包括源程序，仿真波形和实验结果及分析结论等。
-Completed the design of the communication system data interleaver design requirements using Verilog HDL programming, including source code, simulation waveforms and experimental results an
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在Quartus软件中用Verilog HDL编写的D触发器的源代码-In the the Quartus software using the Verilog HDL prepared D flip-flop the source code
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在QuartusII软件中用Verilog HDL编写的关于分频器的源代码-With in QuartusII software written in Verilog HDL source code of the divider
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在QuartusII软件中用Verilog HDL编写的计数器的源代码-Verilog HDL prepared counter with in QuartusII software source code
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在QuartusII软件中用Verilog HDL编写的移位寄存器的源代码-The source code of the shift register in QuartusII software using Verilog HDL prepared
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在QuartusII软件中用Verilog HDL编写的RS编码器的源代码-The RS encoder Verilog HDL prepared with in QuartusII software source code
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同步与异步FIFO的verilog实现，包括源代码，testbench，测试以及综合通过，还有相关参考资料-Synchronous and asynchronous FIFO verilog achieve, including source code, testbench, test and integrated through, as well as related references
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基于Verilog的分频计数源代码，配合深入浅出玩转FPGA一书的实验2使用。-Verilog-based division counting source code
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深入浅出玩转FPGA一书的基础实验源代码，采用Verilog描述-FPGA source code
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红色飓风II开发板USB2FPGA USB驱动程序，由verilog编写，包括源码和FIFO测试程序-Red Hurricane II development board USB2FPGA USB driver from verilog preparation, including source code and test procedures FIFO
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利用vhdl和verilog两种方式可以实现的fpga芯片的数字钟，其中包含多个可设计改动的个性化模块。源代码利用quartusii平台写作，可移植性很强。-Using vhdl and verilog fpga can be achieved in two ways-chip digital clock, which includes several design changes personality module. Source code using the platform quartu
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课程设计，数字频率计源代码，用Verilog HDL写的-Curriculum design, digital frequency meter source code, written using Verilog HDL
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使用verilog编写的密码电子锁。包含源码以及相关文档。-Verilog code written using electronic locks. Including source code and related documentation.
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